Institutional Repository
Technical University of Crete
EN  |  EL

Search

Browse

My Space

Implementation of ARM processor by using Bluespec language

Pekridis Georgios

Simple record


URIhttp://purl.tuc.gr/dl/dias/AA9BF518-0108-4F87-A6A7-5A488FBC7B25-
Identifierhttps://doi.org/10.26233/heallink.tuc.71171-
Languageen-
Extent70 pagesen
TitleImplementation of ARM processor by using Bluespec languageen
TitleΥλοποίηση επεξεργαστή ARM με χρήση γλώσσας Bluespecel
CreatorPekridis Georgiosen
CreatorΠεκριδης Γεωργιοςel
Contributor [Thesis Supervisor]Pnevmatikatos Dionysiosen
Contributor [Thesis Supervisor]Πνευματικατος Διονυσιοςel
Contributor [Committee Member]Dollas Apostolosen
Contributor [Committee Member]Δολλας Αποστολοςel
Contributor [Committee Member]Papaefstathiou Ioannisen
Contributor [Committee Member]Παπαευσταθιου Ιωαννηςel
PublisherΠολυτεχνείο Κρήτηςel
PublisherTechnical University of Creteen
Academic UnitΠολυτεχνείο Κρήτης::Σχολή Ηλεκτρολόγων Μηχανικών και Μηχανικών Υπολογιστώνel
DescriptionΔιπλωματική εργασία που υποβλήθηκε στη σχολή ΗΜΜΥ του Πολυτεχνείου Κρήτης για την πλήρωση των προϋποθέσεων λήψης του διπλώματοςel
Content SummaryΟ σκοπός αυτής της διπλωματικής ήταν να δημιουργηθεί ένας επεξεργαστής ARM με τη χρήση της γλώσσας προγραμματισμού Bluespec System Verilog(BSV). Η BSV έχει μία θεμελιωδώς διαφορετική προσέγγιση στη σχεδίαση υλικού, συγκριτικά με άλλες γλώσσες περιγραφής υλικού. Βασίζεται στη δημιουργία κυκλωμάτων από ότι στην απλή περιγραφή κυκλωμάτων και επίσης βασίζεται σε ατομικούς κανόνες συναλλαγών αντί για μια συνολική σύγχρονη άποψη του κόσμου. O επεξεργαστής είναι μέλος της ARM7 οικογένειας επεξεργαστών, έχει 3 στάδια pipeline, χρησιμοποιεί 32-bit αρχιτεκτονική και βασίζεται στο ARMv4 σύνολο εντολών. Επιπλέον ο επεξεργαστής υποστηρίζει όλα τα διαφορετικά modes λειτουργίας. Τα mode λειτουργίας είναι User, Fast Interrupt(FIQ), Interrupt(IRQ), Supervisor, Abort, System και Undefined. Ο αριθμός των τύπων των διαφορετικών εντολών που υλοποιήθηκαν είναι 26. Ο καθένας από αυτούς τους διαφορετικούς τύπους έχει επιπλέον λειτουργίες ανάλογα της συνθήκη της εντολής και το τρόπο με τον οποίο έχει διευθυνσιοδότηθεί. Για την επιβεβαίωσης της σωστής λειτουργίας του επεξεργαστή χρησιμοποιήθηκε κώδικας assembly . Αυτός ο κώδικας παράχθηκε από κώδικα C++ μέσω του ARM gccel
Content SummaryThe goal of this thesis was to construct an ARM processor using the Bluspec System Verilog language(BSV). BSV has a fundamentally different approach to hardware design, comparing to other Hardware Description Languages. It is based on circuit generation rather than merely circuit description and is also based on atomic transactional rules instead of a globally synchronous view of the world. The processor belongs to the ARM7 family, it has a 3-stage pipeline, it uses a 32-bit architecture and is based on ARMv4 instruction set. In addition the processor supports all the operating modes. The modes of operation are User, Fast Interrupt(FIQ), Interrupt(IRQ), Supervisor, Abort, System and Undefined. The amount of different types of instructions that were implemented is 26. Each and every one of these types has additional functions depending on the condition codes and the addressing modes of the instruction. For the verification of the design, assembly code was used. This assembly code was produced by C++ code, through the ARM GCC.en
Type of ItemΔιπλωματική Εργασίαel
Type of ItemDiploma Worken
Licensehttp://creativecommons.org/licenses/by-nc-sa/4.0/en
Date of Item2018-01-22-
Date of Publication2018-
Subject3 Stages Pipelineen
Subject32biten
SubjectARMen
SubjectARMv4en
SubjectBluespecen
SubjectBluespec System Verilogen
SubjectProcessoren
SubjectΕπεξεργαστήςel
Bibliographic CitationGeorgios Pekridis, "Implementation of ARM processor by using Bluespec language", Diploma Work, School of Electrical and Computer Engineering, Technical University of Crete, Chania, Greece, 2018el
Bibliographic CitationΓεώργιος Πεκρίδης, "Υλοποίηση επεξεργαστή ARM με χρήση γλώσσας Bluespec", Διπλωματική Εργασία, Σχολή Ηλεκτρολόγων Μηχανικών και Μηχανικών Υπολογιστών, Πολυτεχνείο Κρήτης, Χανιά, Ελλάς, 2018el

Available Files

Services

Statistics